“在依然能够获得良好 SNR 结果的情况下，最差情况的 ADC 时钟可怎样呢?”
通常，它需要一个可具有高达 1nsRMS 抖动的函数发生器 。常常需要采用一个高质量的 RF 发生器或晶体振荡器以从 16 或 18 位 ADC 获得最佳的 SNR 值，即使在相对较低的输入频率下也不例外 。本文我将使用安装了 LTC2389-18 2.5Msps 18 位 ADC 和 LTC PScope 软件的 DC1826A-A 演示板，来说明抖动对于 SNR 性能的影响以及怎样降低一个噪声时钟源的抖动 。
作为基线，DC1826A-A 的时钟输入采用一个罗德与施瓦茨 SMB100A RF 发生器来驱动，并由 Stanford Research SR1 提供模拟输入 。结果是图 1 中的 PScope 数据，其产生一个 98.247dBFS SNR 。

文章插图



图 1：基线 FFT 显示：对于 LTC2389-18，SNR 为 98.247dBFS
该 SNR 是通过将低于全标度的输入电平 (-1.047dBFS) 加至已测 SNR 获得的 。ADC 之 CNV 输入端上的 18.8psRMS 抖动可采用一台 Agilent Infiniium 9000 系列示波器或同等档次的示波器进行测量 。基于抖动和输入频率的 SNR 理论极限值为
20 * log (2 * π * fIN * tjitter)

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